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TÃtulo: | Improving early design stage timing modeling in multicore based real-time systems |
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Autor/a: | Trilla, David; Jalle Ibarra, Javier; Fernández, Mikel; Abella Ferrer, Jaume; Cazorla Almeida, Francisco Javier |
Otros autores: | Universitat Politècnica de Catalunya. Departament d'Arquitectura de Computadors; Universitat Politècnica de Catalunya. CAP - Grup de Computació d'Altes Prestacions |
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Materia(s): | -Àrees temà tiques de la UPC::Informà tica::Arquitectura de computadors -Multiprocessors -Embedded computer systems -Application programs -Budget control -Design -Embedded systems -Interactive computer systems -Associated costs -Computing platform -Early design phasis -Early design stages -Multi-core processor -Real-time embedded systems -Software suppliers -System integrators -Multiprocessadors -Ordinadors immersos, Sistemes d' |
Derechos: | |
Tipo de documento: | ArtÃculo - Versión presentada Objeto de conferencia |
Editor: | Institute of Electrical and Electronics Engineers (IEEE) |
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