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RECERCAT Principal > Universitat Politècnica de Catalunya > Documents de recerca > Visualizar documento

Para acceder a los documentos con el texto completo, por favor, siga el siguiente enlace: http://hdl.handle.net/2117/22070

Título:	Hardware-efficient implementation of a femtocell/macrocell interference-mitigation technique for high-performance LTE-based systems
Autor/a:	Font Bach, Oriol; Bartzoudis, Nikolaos; Pascual Iserte, Antonio; Payaró Llisterri, Miquel
Otros autores:	Universitat Politècnica de Catalunya. Departament de Teoria del Senyal i Comunicacions; Universitat Politècnica de Catalunya. SPCOM - Grup de Recerca de Processament del Senyal i Comunicacions
Abstract:	This paper presents the FPGA design of an interference-aware digital front end tailored for heterogeneous multi-cell LTE-based systems. A resource-optimized RTL architecture has been implemented and validated under realistic operating conditions using the GEDOMIS® testbed. The parallelization and concurrent resource utilization of the joint synchronization and interference detection processing blocks is covered with low-level details.
Abstract:	Peer Reviewed
Materia(s):	Àrees temàtiques de la UPC::Enginyeria de la telecomunicació::Radiocomunicació i exploració electromagnètica::Comunicacions mòbils Long-Term Evolution (Telecommunications) Interference (Sound) Synchronization Field programmable gate arrays Finite impulse response filters Interference OFDM Real-time systems Resource management Synchronization Long-term evolution (Telecomunicacions) Sincronització Interferències
Derechos:
Tipo de documento:	info:eu-repo/semantics/publishedVersion info:eu-repo/semantics/conferenceObject
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