To access the full text documents, please follow this link: http://hdl.handle.net/2117/20567

Combining RAM technologies for hard-error recovery in L1 data caches working at very-low power modes
Lorente, Vicente; Valero, Alejandro; Sahuquillo, Julio; Petit, Salvador; Canal Corretger, Ramon; López, Pedro; Duato, José
Universitat Politècnica de Catalunya. Departament d'Arquitectura de Computadors; Universitat Politècnica de Catalunya. ARCO - Microarquitectura i Compiladors
Àrees temàtiques de la UPC::Informàtica::Sistemes d'informació::Emmagatzematge i recuperació de la informació
Àrees temàtiques de la UPC::Informàtica::Arquitectura de computadors
Information storage and retrieval systems
Cache memory
Memory
DRAM
SRAM
Informació -- Sistemes d'emmagatzematge i recuperació
Memòria ràpida de treball (Informàtica)
info:eu-repo/semantics/publishedVersion
info:eu-repo/semantics/conferenceObject
         

Show full item record

Related documents

Other documents of the same author

Valero, Alejandro; Sahuquillo, Julio; Petit, Salvador; Lorente, Vicente; Canal Corretger, Ramon; López, Pedro; Duato, José
Subirats, Marina; López, Pedro; Sánchez i Miret, Cristina
Jing, Naifeng; Shen, Yao; Lu, Yao; Ganapathy, Shrikanth; Mao, Zhigang; Guo, Minyi; Canal Corretger, Ramon; Liang, Xiaoyao
Ganapathy, Shrikanth; Canal Corretger, Ramon; González Colás, Antonio María; Rubio Sola, Jose Antonio
 

Coordination

 

Supporters