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DLL's behavioral modeling for power consumption and jitter fast optimization
Barajas Ojeda, Enrique; Mateo Peña, Diego; González Jiménez, José Luis
Universitat Politècnica de Catalunya. Departament d'Enginyeria Electrònica; Universitat Politècnica de Catalunya. HIPICS - Grupo de Circuitos y Sistemas Integrados de Altas Prestaciones
Àrees temàtiques de la UPC::Enginyeria de la telecomunicació::Processament del senyal
Delay lock loops
Logic design
Jitter
DLL
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info:eu-repo/semantics/conferenceObject
         

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