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Implementation of systolic algorithms using pipelined functional units
Valero García, Miguel; Navarro Guerrero, Juan José; Llaberia Griñó, José M.; Valero Cortés, Mateo
Universitat Politècnica de Catalunya. Departament d'Arquitectura de Computadors; Universitat Politècnica de Catalunya. ICARUS - Intelligent Communications and Avionics for Robust Unmanned Aerial Systems; Universitat Politècnica de Catalunya. CAP - Grup de Computació d'Altes Prestacions
Àrees temàtiques de la UPC::Informàtica::Arquitectura de computadors
Pipelining (Electronics)
Systolic array circuits
Processadors de matrius (arrays)
Algorismes
info:eu-repo/semantics/publishedVersion
info:eu-repo/semantics/conferenceObject
         

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